5.4 Tercera etapa

En esta etapa se incorporaron las instrucciones de manejo de pila y de interrupciones, ampliando la funcionalidad del simulador para cubrir un conjunto más completo de operaciones propias de la arquitectura x86. A continuación, se detalla el conjunto completo de instrucciones, incluyendo su clasificación, nemónicos y las acciones que representan.

Tabla 5.12: Tabla de Instrucciones y Códigos de Operación de la Arquitectura x86

Código operación	Instrucciones	Nemónico	Acción
MOV	Transferencia de datos	MOV destino, origen	1- Copiar entre registros 2- Cargar a registro 3- Almacenar en memoria
ADD	Aritmética	ADD destino, origen	1- Sumar 2- Restar 3- Comparar
JMP	Control de flujo	JMP destino	Salto incondicional JMP. Saltos condicionales Jxx. Llamadas a rutinas CALL y retorno RET
PUSH, POP, OUT, IN	Pila y E/S	PUSH, POP, OUT, IN	Poner en la pila PUSH. Retirar de la pila POP. Enviar un byte al puerto del dispositivo de E/S. Recibir un byte del dispositivo de E/S
INT , IRET	Interrupciones	INT , IRET	Llamar a una rutina de tratamiento de interrupción INT. Retornar de una rutina de tratamiento de interrupción IRET
NOP , HLT	Control	NOP , HLT	No opera NOP. Detiene el CPU HLT